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Diseño Combinacional

La peor decisión es la indecisión. �Benjamín Franklin

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Abril 2024

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Electrónica Digital

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Actividades y proyectos en proceso

	Actividad	Puntos	Fecha límite
PF6	Solución del examen	F
PF7	Diseño Combinacional con HDL	F
PF8	Multiplexor	5
AF3	Decodificador con Display	10
PF9	Flip Flops	F
PF10	Pulsos de sincronía	5
AF4	Diseño Secuencial	10
AF5	PIA	40

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Codificador o Encoder �Es un circuito que convierte una señal de entrada en un código específico de bits

2^N

N

Decodificador o Decoder

Es un circuito que realiza la operación inversa, �convirtiendo un código de bits en una señal de salida.

M

N

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Codificador�Encoder

Es un circuito combinacional con 2^N entradas y N salidas.

Su salida es el código binario correspondiente a la entrada activada.

2^N

N

m	X	Y
0	0	0	Verde
1	0	1	Flecha
2	1	0	Ambar
3	1	1	Rojo

Verde

Flecha

Ambar

Rojo

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Codificador de prioridad (Priority Encoder)

Definiciones:

Codificador Proceso en el cual se obtiene un código para cada una de las posibles entradas.

Código Combinación de signos que tiene un determinado valor dentro de un sistema establecido.

Prioridad Anterioridad de algo respecto de otra cosa, en tiempo, en orden.

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Codificador de prioridad (Priority Encoder)

Diseñe un Codificador de prioridad �de 8 líneas de entrada a 3 bit´s de salida.

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Codificador de prioridad (Priority Encoder)

Las salidas (S2, S1, S0) debe de ser el número en código binario correspondiente a la línea de entrada de mayor valor que contenga un uno.

1

0

1

0

1

5

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Diagrama de bloques

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Diagrama de bloques

0

1

0

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Diagrama de bloques

0

1

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Tabla de Verdad

Con ocho entradas se tienen 256 posibles combinaciones.

En este ejemplo no es necesario listarlas todas ya que gracias al Don´t care (.x.).

En las combinaciones de entrada, se puede representar el comportamiento del codificador de prioridad con solo 9 combinaciones como lo muestra la siguiente tabla.

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	V

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	V
1

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	V
1	X	X	X	X	X	X	X

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0
0	1	X	X	X	X	X	X	1	1	0	6	0

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0
0	1	X	X	X	X	X	X	1	1	0	6	0
0	0	1	X	X	X	X	X	1	0	1	5	0

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0
0	1	X	X	X	X	X	X	1	1	0	6	0
0	0	1	X	X	X	X	X	1	0	1	5	0
0	0	0	1	X	X	X	X	1	0	0	4	0
0	0	0	0	1	X	X	X	0	1	1	3	0

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0
0	1	X	X	X	X	X	X	1	1	0	6	0
0	0	1	X	X	X	X	X	1	0	1	5	0
0	0	0	1	X	X	X	X	1	0	0	4	0
0	0	0	0	1	X	X	X	0	1	1	3	0
0	0	0	0	0	1	X	X	0	1	0	2	0
0	0	0	0	0	0	1	X	0	0	1	1	0

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0
0	1	X	X	X	X	X	X	1	1	0	6	0
0	0	1	X	X	X	X	X	1	0	1	5	0
0	0	0	1	X	X	X	X	1	0	0	4	0
0	0	0	0	1	X	X	X	0	1	1	3	0
0	0	0	0	0	1	X	X	0	1	0	2	0
0	0	0	0	0	0	1	X	0	0	1	1	0
0	0	0	0	0	0	0	1	0	0	0	0	0

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Tabla de Verdad

Entradas								Salidas
L7	L6	L5	L4	L3	L2	L1	L0	S2	S1	S0	N₍₁₀₎	V
1	X	X	X	X	X	X	X	1	1	1	7	0
0	1	X	X	X	X	X	X	1	1	0	6	0
0	0	1	X	X	X	X	X	1	0	1	5	0
0	0	0	1	X	X	X	X	1	0	0	4	0
0	0	0	0	1	X	X	X	0	1	1	3	0
0	0	0	0	0	1	X	X	0	1	0	2	0
0	0	0	0	0	0	1	X	0	0	1	1	0
0	0	0	0	0	0	0	1	0	0	0	0	0
0	0	0	0	0	0	0	0	0	0	0		1

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Archivo en ABEL-HDL

MODULE Penco

declarations

X=.x.;

"Entradas

L7..L0 PIN 1..8;

"salidas

S2..S0,V PIN 17..14 istype 'dc,com';

"SET

S=[S2,S1,S0];

"Tabla de verdad

truth_table

([L7,L6,L5,L4,L3,L2,L1,L0]->[S,V])

[1,X,X,X,X,X,X,X]->[7,0];

[0,1,X,X,X,X,X,X] ->[6,0];

[0,0,1,X,X,X,X,X] ->[5,0];

[0,0,0,1,X,X,X,X] ->[4,0];

[0,0,0,0,1,X,X,X] ->[3,0];

[0,0,0,0,0,1,X,X] ->[2,0];

[0,0,0,0,0,0,1,X] ->[1,0];

[0,0,0,0,0,0,0,1] ->[0,0];

[0,0,0,0,0,0,0,0] ->[0,1];

test_vectors

([L7,L6,L5,L4,L3,L2,L1,L0]->[S2,S1,S0,V])

[1,X,X,X,X,X,X,X]->[X,X,X,X];

[0,1,X,X,X,X,X,X]->[X,X,X,X];

[0,0,1,X,X,X,X,X]->[X,X,X,X];

[0,0,0,1,X,X,X,X]->[X,X,X,X];

[0,0,0,0,1,X,X,X]->[X,X,X,X];

[0,0,0,0,0,1,X,X]->[X,X,X,X];

[0,0,0,0,0,0,1,X]->[X,X,X,X];

[0,0,0,0,0,0,0,1]->[X,X,X,X];

[0,0,0,0,0,0,0,0]->[X,X,X,X];

END ;

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$Bus1=S2,S1;S0

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Decodificadores

Los libros son las abejas que llevan el polen de una inteligencia a otra.

James Russell Lowell (1819-1891) Poeta y escritor estadounidense.

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Decodificador�Decoder

Convierte un código binario de entrada de N bits de entrada a M líneas de salida.

M

N

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Decodificador de 2 a 4 líneas

Decodificador:

Proceso que permite pasar de un lenguaje codificado (código) a otro legible directamente (línea).

Diagrama de bloques

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Decodificador de 2 a 4 líneas

El valor binario de A, B de entrada deberá seleccionar la línea de salida por medio de un nivel alto (uno).

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Decodificador de 2 a 4 líneas

Tabla de verdad

	Entradas		Salidas
m	A	B	V	F	A	R
0	0	0
1	0	1
2	1	0
3	1	1

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Decodificador de 2 a 4 líneas

Tabla de verdad

	Entradas		Salidas
m	A	B	V	F	A	R
0	0	0	0	0	0	1
1	0	1
2	1	0
3	1	1

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Decodificador de 2 a 4 líneas

Tabla de verdad

	Entradas		Salidas
m	A	B	V	F	A	R
0	0	0	0	0	0	1
1	0	1	0	0	1	0
2	1	0
3	1	1

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Decodificador de 2 a 4 líneas

Tabla de verdad

	Entradas		Salidas
m	A	B	V	F	A	R
0	0	0	0	0	0	1
1	0	1	0	0	1	0
2	1	0	0	1	0	0
3	1	1

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Decodificador de 2 a 4 líneas

Tabla de verdad

	Entradas		Salidas
m	A	B	V	F	A	R
0	0	0	0	0	0	1
1	0	1	0	0	1	0
2	1	0	0	1	0	0
3	1	1	1	0	0	0

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Decodificador de 2 a 4 líneas

Ecuaciones mínimas

	Entradas		Salidas
m	A	B	V	F	A	R
0	0	0	0	0	0	1
1	0	1	0	0	1	0
2	1	0	0	1	0	0
3	1	1	1	0	0	0

V(A,B) = A’ B’

F(A,B) = A’ B

A(A,B) = A B’

R(A,B) = A B

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Decodificador de 3 a 8 líneas

Diagrama de bloques

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Electrónica Digital I

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Decodificador de 3 a 8 líneas

Tabla de Verdad

M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
0	0	0	0	0	0	0	0	0	0	0	1
1	0	0	1
2	0	1	0
3	0	1	1
4	1	0	0
5	1	0	1
6	1	1	0
7	1	1	1

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Electrónica Digital I

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Decodificador de 3 a 8 líneas

Tabla de Verdad

M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
0	0	0	0	0	0	0	0	0	0	0	1
1	0	0	1	0	0	0	0	0	0	1	0
2	0	1	0
3	0	1	1
4	1	0	0
5	1	0	1
6	1	1	0
7	1	1	1

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38 of 87

Decodificador de 3 a 8 líneas

Tabla de Verdad

M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
0	0	0	0	0	0	0	0	0	0	0	1
1	0	0	1	0	0	0	0	0	0	1	0
2	0	1	0	0	0	0	0	0	1	0	0
3	0	1	1	0	0	0	0	1	0	0	0
4	1	0	0	0	0	0	1	0	0	0	0
5	1	0	1	0	0	1	0	0	0	0	0
6	1	1	0	0	1	0	0	0	0	0	0
7	1	1	1	1	0	0	0	0	0	0	0

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39 of 87

Decodificador de 3 a 8 líneas nivel activo bajo

Diagrama de bloques

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Electrónica Digital I

40 of 87

Decodificador de 3 a 8 líneas nivel activo bajo

Tabla de Verdad

M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
0	0	0	0	1	1	1	1	1	1	1	0
1	0	0	1	1	1	1	1	1	1	0	1
2	0	1	0	1	1	1	1	1	0	1	1
3	0	1	1	1	1	1	1	0	1	1	1
4	1	0	0	1	1	1	0	1	1	1	1
5	1	0	1	1	1	0	1	1	1	1	1
6	1	1	0	1	0	1	1	1	1	1	1
7	1	1	1	0	1	1	1	1	1	1	1

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Decodificador de 3 a 8 lineas nivel activo bajo�

MODULE deco

A,B,C PIN 1..3;

L0..L7 PIN 14..21 ISTYPE 'COM';TRUTH_TABLE

([A,B,C]->[L0,L1,L2,L3,L4,L5,L6,L7])

[0,0,0]->[0,1,1,1,1,1,1,1];

[0,0,1]->[1,0,1,1,1,1,1,1];

[0,1,0]->[1,1,0,1,1,1,1,1];

[0,1,1]->[1,1,1,0,1,1,1,1];

[1,0,0]->[1,1,1,1,0,1,1,1];

[1,0,1]->[1,1,1,1,1,0,1,1];

[1,1,0]->[1,1,1,1,1,1,0,1];

[1,1,1]->[1,1,1,1,1,1,1,0];

TEST_VECTORS

([A,B,C]->[L0,L1,L2,L3,L4,L5,L6,L7])

[0,0,0]->[0,1,1,1,1,1,1,1];

[0,0,1]->[1,0,1,1,1,1,1,1];

[0,1,0]->[1,1,0,1,1,1,1,1];

[0,1,1]->[1,1,1,0,1,1,1,1];

[1,0,0]->[1,1,1,1,0,1,1,1];

[1,0,1]->[1,1,1,1,1,0,1,1];

[1,1,0]->[1,1,1,1,1,1,0,1];

[1,1,1]->[1,1,1,1,1,1,1,0];

END

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Decodificador de BCD a siete Segmentos

7 Segmentos: se refiere a un DISPLAY (dispositivo para mostrar resultados) compuesto por LED’s (Diodos emisores de luz) distribuidos de tal suerte que se puedan mostrar los dígitos del 0 al 9.

BCD Código Decimal (0 – 9) expresado en Binario (0000 -1001), cada digito del decimal se representa por cuatro bits ejemplo 4678₍₁₀₎ 0100 0110 0111 1000 _(BCD).

4678₍₁₀₎ =1001001000110₍₂₎

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Display de 7 segmentos

Ánodo Común

Cátodo Común

Enciende con un cero

Enciende con un uno

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Identificación de terminales del Diaplay

1.- colocar el display en la� tablilla de conexiones

2.- Una de las terminales del display�conectarla al negativo por medio

De un resistor.

3.- con un alambre conectado al

positivo recorrer las demás

Terminales del dsiplay e identificar

Con cuales enciende un segmento

Identificar las terminales comunes

4.- en caso de que no encienda ningún

Segmento, invertir la

Polaridad de la fuente y repetir

El paso 3

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1	g
2	f
3	Común
4	A
5	b
6	dp
7	c
8	Común
9	d
10	e

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https://agelectronica.lat/pdfs/textos/G/GM1-5611AURB.PDF

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Electrónica Digital I

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Decodificador de BCD a siete Segmentos

Diagrama de bloques

BCD

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52 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0
1	0 0 0 1
2	0 0 1 0
3	0 0 1 1
4	0 1 0 0
5	0 1 0 1
6	0 1 1 0
7	0 1 1 1
8	1 0 0 0
9	1 0 0 1
10	1 0 1 0
11	1 0 1 1
12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Oct. 2023

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Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0
1	0 0 0 1
2	0 0 1 0
3	0 0 1 1
4	0 1 0 0
5	0 1 0 1
6	0 1 1 0
7	0 1 1 1
8	1 0 0 0
9	1 0 0 1
10	1 0 1 0
11	1 0 1 1
12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

0

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

54 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0
1	0 0 0 1
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10	1 0 1 0
11	1 0 1 1
12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Ánodo Común

0

1

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

55 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1
2	0 0 1 0
3	0 0 1 1
4	0 1 0 0
5	0 1 0 1
6	0 1 1 0
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11	1 0 1 1
12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

0

1

0

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

56 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
2	0 0 1 0
3	0 0 1 1
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7	0 1 1 1
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12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

0

1

0

1

Oct. 2023

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Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

57 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
2	0 0 1 0	1	1	0	1	1	0	1
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12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

0

1

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

58 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
2	0 0 1 0	1	1	0	1	1	0	1
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12	1 1 0 0
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14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

0

1

0

1

Oct. 2023

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Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

59 of 87

Tabla de� Verdad

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
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12	1 1 0 0
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14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

0

1

0

1

Oct. 2023

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Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

60 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
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12	1 1 0 0
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14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

X

0

1

Oct. 2023

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Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

61 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
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12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

0

Oct. 2023

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Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

62 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
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5	0 1 0 1	1	0	1	1	0	1	1
6	0 1 1 0	X	0	1	1	1	1	1
7	0 1 1 1	1	1	1	0	0	0	0
8	1 0 0 0
9	1 0 0 1
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11	1 0 1 1
12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

63 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
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5	0 1 0 1	1	0	1	1	0	1	1
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7	0 1 1 1	1	1	1	0	0	0	0
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11	1 0 1 1
12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Considerando

Cátodo Común

1

X

0

1

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

64 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
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12	1 1 0 0
13	11 0 1
14	1 1 1 0
15	1 1 1 1

Código BCD

0 a 9

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

65 of 87

m	A B C D	a	b	c	d	e	f	g	N₍₁₀₎	N₍₁₆₎
0	0 0 0 0	1	1	1	1	1	1	0	126	7E
1	0 0 0 1	0	1	1	0	0	0	0	48	30
2	0 0 1 0	1	1	0	1	1	0	1	109	6D
3	0 0 1 1	1	1	1	1	0	0	1	121	79
4	0 1 0 0	0	1	1	0	0	1	1	51	33
5	0 1 0 1	1	0	1	1	0	1	1	91	5B
6	0 1 1 0	X	0	1	1	1	1	1
7	0 1 1 1	1	1	1	0	0	0	0	112	70
8	1 0 0 0	1	1	1	1	1	1	1	127	7F
9	1 0 0 1	1	1	1	X	0	1	1	123	7B
10	1 0 1 0	X	X	X	X	X	X	X
11	1 0 1 1	X	X	X	X	X	X	X
12	1 1 0 0	X	X	X	X	X	X	X
13	11 0 1	X	X	X	X	X	X	X
14	1 1 1 0	X	X	X	X	X	X	X
15	1 1 1 1	X	X	X	X	X	X	X

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

66 of 87

Archivo ABEL-HDL

MODULE BCD

" Entradas

A,B,C,D PIN 1,2,3,4;

"Salidas

a,b,c,d,e,f,g pin 16,17,18,12,13,15,14 istype ‘com,dc’;

S= [A,B,C,D];

“ Tabla de verdad para Cátodo Común

truth_table

([S]->[a,b,c,d,e,f,g])

[0]-> [1,1,1,1,1,1,0];

[1]-> [0,0,1,1,0,0,0];

[2]-> [1,1,0,1,1,0,1];

[3]-> [1,1,1,1,0,0,1];

[4]-> [0,1,1,0,0,1,1];

[5]-> [1,0,1,1,0,1,1];

[6]-> [.x.,0,1,1,1,1,1];

[7]-> [1,1,1,0,0,0,0];

[8]-> [1,1,1,1,1,1,1];

[9]-> [1,1,1,.x.,0,1,1];

END

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

67 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
2	0 0 1 0	1	1	0	1	1	0	1
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6	0 1 1 0	X	0	1	1	1	1	1
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8	1 0 0 0	1	1	1	1	1	1	1
9	1 0 0 1	1	1	1	X	0	1	1
10	1 0 1 0	1	0	0	1	1	1	1
11	1 0 1 1	1	0	0	1	1	1	1
12	1 1 0 0	1	0	0	1	1	1	1
13	11 0 1	1	0	0	1	1	1	1
14	1 1 1 0	1	0	0	1	1	1	1
15	1 1 1 1	1	0	0	1	1	1	1

Con una

E �de error

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

68 of 87

Archivo ABEL-HDL

Con E de error

MODULE BCD

" Entradas

A,B,C,D PIN 1,2,3,4;

"Salidas

a,b,c,d,e,f,g pin 16,17,18,12,13,15,14 istype ‘com,dc’;

S= [A,B,C,D];

“ Tabla de verdad para Cátodo Común

truth_table

([S]->[a,b,c,d,e,f,g])

[0]-> [1,1,1,1,1,1,0];

[1]-> [0,0,1,1,0,0,0];

[2]-> [1,1,0,1,1,0,1];

[3]-> [1,1,1,1,0,0,1];

[4]-> [0,1,1,0,0,1,1];

[5]-> [1,0,1,1,0,1,1];

[6]-> [.x.,0,1,1,1,1,1];

[7]-> [1,1,1,0,0,0,0];

[8]-> [1,1,1,1,1,1,1];

[9]-> [1,1,1,.x.,0,1,1];

[10]-> [1,0,0,1,1,1,1];

[11]-> [1,0,0,1,1,1,1];

[12]-> [1,0,0,1,1,1,1];

[13]-> [1,0,0,1,1,1,1];

[14]-> [1,0,0,1,1,1,1];

[15]-> [1,0,0,1,1,1,1];

END

Oct. 2023

Universidad Autónoma de Nuevo León

Facultad de Ingeniería Mecánica y Eléctrica

Juan Angel Garza Garza

Sistemas Digitales

Electrónica Digital I

69 of 87

m	A B C D	a	b	c	d	e	f	g
0	0 0 0 0	1	1	1	1	1	1	0
1	0 0 0 1	0	1	1	0	0	0	0
2	0 0 1 0	1	1	0	1	1	0	1
3	0 0 1 1	1	1	1	1	0	0	1
4	0 1 0 0	0	1	1	0	0	1	1
5	0 1 0 1	1	0	1	1	0	1	1
6	0 1 1 0	1	0	1	1	1	1	1
7	0 1 1 1	1	1	1	0	0	0	0
8	1 0 0 0	1	1	1	1	1	1	1
9	1 0 0 1	1	1	1	X	0	1	1
10	1 0 1 0	1	1	0	1	1	1	1	A
11	1 0 1 1	0	0	1	1	1	1	1	b
12	1 1 0 0	1	0	0	1	1	1	0	C
13	1 1 0 1	0	1	1	1	1	0	1	d
14	1 1 1 0	1	0	0	1	1	1	1	E
15	1 1 1 1	1	0	0	0	1	1	1	F

Decodificador de Hexadecimal a 7 segmentos

Oct. 2023

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Sistemas Digitales

Electrónica Digital I

70 of 87

Archivo ABEL-HDL

Hexadecimal a 7 segmentos

MODULE BCD

" Entradas

A,B,C,D, LT PIN 1,2,3,4,5;

"Salidas

a,b,c,d,e,f,g pin 16,17,18,12,13,15,14 istype ‘com,dc’;

S= [A,B,C,D];

“ Tabla de verdad para Cátodo Común

truth_table

([S]->[a,b,c,d,e,f,g])

[0]-> [1,1,1,1,1,1,0];

[1]-> [0,0,1,1,0,0,0];

[2]-> [1,1,0,1,1,0,1];

[3]-> [1,1,1,1,0,0,1];

[4]-> [0,1,1,0,0,1,1];

[5]-> [1,0,1,1,0,1,1];

[6]-> [1,0,1,1,1,1,1];

[7]-> [1,1,1,0,0,0,0];

[8]-> [1,1,1,1,1,1,1];

[9]-> [1,1,1,.x.,0,1,1];

[10]-> [1,1,0,1,1,1,1];

[11]-> [0,0,1,1,1,1,1];

[12]-> [1,0,0,1,1,1,0];

[13]-> [0,1,1,1,1,0,1];

[14]-> [1,0,0,1,1,1,1];

[15]-> [1,0,0,0,1,1,1];

END

Oct. 2023

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Sistemas Digitales

Electrónica Digital I

71 of 87

Actividad Fundamental 3 Decodificador de BCD a 7 segmentos�

1.- Mostrar los números del 0 al 9.

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Sistemas Digitales

Electrónica Digital I

72 of 87

Prueba de Lámpara

MODULE BCD

X=.x.;

" Entradas

A,B,C,D,LT PIN 1..5;

"Salidas

a,b,c,d,e,f,g,dp pin 16,17,18,12,13,15,14,19istype ‘com,dc’;

“ Tabla de verdad para Cátodo Común

truth_table

([LT,A,B,C,D ]->[a,b,c,d,e,f,g,dp])

[1,X,X,X,X]->[1,1,1,1,1,1,1,1];

[0,0,0,0,0]->[1,1,1,1,1,1,0,0];

[0,0,0,0,1]->[0,1,1,0,0,0,0,0];

2.- Incluir una entrada adicional al código BCD, por medio de un Push Botón llamada LT (Lamp Test) prueba de lampara, de modo al oprimirlo (LT=1) todos los segmentos deberán de encender incluyendo el punto decimal.

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Sistemas Digitales

Electrónica Digital I

73 of 87

Actividad Fundamental 3 Decodificador de BCD a 7 segmentos�

3.- Para las combinaciones del 10 al 15 proponga una palabra de seis caracteres (una letra por cada combinación), además encienda el punto decimal. (hay que registrar la palabra para asegurar que aún no este registrada)

Dicha palabra se deberá de verificar que aún no está registrada en el siguiente enlace: Y de ser así. registra tu propuesta en el siguiente enlace:

https://uanledu.sharepoint.com/:x:/s/BecariosAE20-21/EcaHwUMPYedOrmGuG23uoVoB4exFQs6vssDckbljdj8QUA?e=GMF7gJ

	a	b	c	d	e	f	g
A	1	1	1	0	1	1	1	119
b	0	0	1	1	1	1	1	31
C	1	0	0	1	1	1	0	78
d	0	1	1	1	1	1	0	62
E	1	0	0	1	1	1	1	79
F	1	0	0	0	1	1	1	71
G	0	1	1	1	1	1	1	63
H	0	1	1	0	1	1	1	55
I	0	1	1	0	0	0	0	48
J	0	1	1	1	1	0	0	60
L	0	0	0	1	1	1	0	14
N	1	1	0	1	1	1	0	110
O	1	1	1	1	1	1	0	126
P	1	1	0	0	1	1	1	103
S	1	0	1	1	0	1	1	91
U	0	1	1	0	0	1	0	50
Y	1	1	1	0	0	1	1	115
Z	1	1	1	1	0	1	0	122

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Sistemas Digitales

Electrónica Digital I

74 of 87

Listado de palabras

1		abedul
2		Abejas
3		ACCESO
4		Acerbo
5		Acerca
6		Acuerdo
7		Afable
8		Ahorca
9		Alegró
10		Algún
11		Aliger
12		Alzado
13		Ancora
14		Anhelo
15		Anillo
16		Ardeos

17		Arduos
18		Arocho
19		Ascend
20		Asedio
21		bailar
22		BALASO
23		BANANA
24		BAncos
25		Bander
26		Blanco
27		Blando
28		Bobina
29		BONDAD
30		Brindo
31		Broche
32		Cadena

33		Cádiz
34		Calder
35		Calzar
36		Canción
37		CANINO
38		Cardeo
39		Cargó
40		Cargón
41		Carino
42		casado
43		CASUAL
44		Caudro
45		CELULA
46		Cerado
47		CESPED
48		CHACHA

49		Cherry
50		Ciego
51		Cigüe
52		Clavar
53		Clavio
54		Cobre
55		COCHES
56		Cochó
57		Cocina
58		Codear
59		CODIGO
60		Colada
61		Colear
62		CONEJO
63		Cordel
64		CORONA

No contienen las letras M, T, W

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Juan Angel Garza Garza

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Electrónica Digital I

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Listado de palabras

65		Correa
66		Corsé
67		Credal
68		Críaño
69		Cronen
70		Curado
71		DANIEL
72		Declar
73		Decoro
74		Dedazo
75		Deguar
76		Delgó
77		Densar
78		Desear
79		dibuja
80		DIOSES

81		DORMIR
82		Dragon
83		dulces
84		Echaro
85		Eclips
86		Edición
87		Efesio
88		Elenco
89		Elevó
90		Eloción
91		Encauz
92		Encier
93		Encima
94		Encino
95		Erosión
96		ESCALA

97		Escoba
98		Escudo
99		Esgría
100		ESPUMA
101		Eunice
102		Faquir
103		FELIPE
104		Ferroc
105		Fibrón
106		Fíjose
107		Fijoso
108		Flores
109		Focero
110		FORZAR
111		Fragua
112		Frasco

113		Fuerza
114		Fugaz
115		Fúnebr
116		Furgón
117		Galeno
118		García
119		Gárgol
120		Gíndol
121		Gorjéo
122		Grande
123		Guardó
124		Hacino
125		Halado
126		Hallar
127		helado
128		Hilado

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Electrónica Digital I

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Listado de palabras

129		Hilvan
130		Hombre
131		Hombre
132		IGUANA
133		iloveu
134		INPALA
135		Iraqui
136		Jalone
137		Jaulón
138		Jerogl
139		Juegos
140		Lacero
141		Ladrón
142		LANZAR
143		Lazare
144		Líbido

145		Lisera
146		Lisero
147		Llegó
148		Llevar
149		Logró
150		Lucero
151		Luego
152		Lugaré
153		Lujoso
154		Lupear
155		Lúpulo
156		Obispo
157		OpciOn
158		origen
159		OROPEL
160		Papaya

161		Pensar
162		Perros
163		POLLOS
164		PRUEBA
165		PULSOS
166		QUESOS
167		SABADO
168		SALSAS
169		suceso
170		Unirse
171		Volcan
172		ZÓCALO

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Actividad Fundamental 3 Decodificador de BCD a 7 segmentos�

5.- Elabore la simulación y el Layout (PCB) correspondiente al diseño

https://www.youtube.com/watch?v=Mghag9dMuV8&t=862s&ab_channel=JuanAngelGarzaGarza

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Electrónica Digital I

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Actividad Fundamental 3 Decodificador de BCD a 7 segmentos�

4.- Considere para implementación en un prototipo la asignación necesaria de las terminales de salida de modo que no existan cruces del cableado.

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Electrónica Digital I

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Electrónica Digital I

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Matriz 5 X 7

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Matriz 5 X 7

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Matriz 5 X 7

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	C1	C2	C3	C4	C5	F1	F2	F3	F4	F5	C	F
0	0	0	0	0	0	0	1	1	1	1	0	15
1	1	0	0	0	0	0	1	1	1	1	16	15
2	0	1	0	0	0	0	1	1	1	1	8	15
3	0	0	1	0	0	0	1	1	1	1	4	15
4	0	0	0	1	0	0	1	1	1	1	2	15
5	0	0	0	0	1	0	1	1	1	1	1	15
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10	0	0	0	0	1	1	0	1	1	1	1	23
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22	0	1	0	0	0	1	1	1	1	0	8	30
23	0	0	1	0	0	1	1	1	1	0	4	30
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25	0	0	0	0	1	1	1	1	1	0	1	30

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Electrónica Digital

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M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
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1	0	0	1
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4	1	0	0
5	1	0	1
6	1	1	0
7	1	1	1

M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
0	0	0	0	0	0	0	0	0	0	0	1
1	0	0	1	0	0	0	0	0	0	1	0
2	0	1	0
3	0	1	1
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5	1	0	1
6	1	1	0
7	1	1	1

M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
0	0	0	0	0	0	0	0	0	0	0	1
1	0	0	1	0	0	0	0	0	0	1	0
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M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
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1	0	0	1	1	1	1	1	1	1	0	1
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M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
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M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
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M	A	B	C	L7	L6	L5	L4	L3	L2	L1	L0
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